職責(zé)描述：
develop FPGA design process including requirements generation, preliminary design, peer reviews, detailed design, test plan generation, and test
FPGA設(shè)計(jì)， 包括需求分析，驗(yàn)證設(shè)計(jì)，評(píng)審，代碼設(shè)計(jì)，測(cè)試計(jì)劃和測(cè)試
develop digital logic design using Xilinx UltraScale and/or a Arria & Stratix FPGAs
使用主流FPGA設(shè)計(jì)數(shù)字電路
Close design timing with rstanding of static timing analysis
使用靜態(tài)時(shí)序分析和優(yōu)化設(shè)計(jì)時(shí)序
generate FPGA designs using Vivado or Quartus tool suite
使用工具生成設(shè)計(jì)
Other tasks assigned by the leader
其它未盡事宜

任職要求：
BS Degree in electrical/computer engineering and 3+ years of related experience with FPGA Design
電子工程、計(jì)算機(jī)等相關(guān)專(zhuān)業(yè)，本科或以上學(xué)歷；3年相關(guān)經(jīng)驗(yàn)
Experience using Mentor Questa/ModelSim Simulator
熟悉時(shí)序仿真工具
Experience integrating with HW/software and supporting the complete testing
熟悉軟硬件集成測(cè)試
Good written and written English
具有良好的英文文獻(xiàn)讀寫(xiě)能力

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